基于AXI4.0的千兆位以太网IP的设计

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基于AXI4.0的千兆位以太网IP的设计
论文目录
 
摘要第1-4页
abstract第4-11页
第一章 总论第11-18页
  1.1 研究背景第11页
  1.2 以太网的应用需求第11-13页
  1.3 以太网芯片的现状第13-14页
  1.4 AXI4.0简介第14-16页
    1.4.1 AXI4.0特性第14-15页
    1.4.2 AXI与 AHB对比第15页
    1.4.3 AXI3.0与AXI4.0 比较第15-16页
  1.5 课题研究目标第16页
    1.5.1 AXI4.0 接口第16页
    1.5.2 以太网接口第16页
    1.5.3 DMA引擎第16页
    1.5.4 数据包处理器第16页
  1.6 本章小结第16-18页
第二章 千兆位以太网IP的相关理论第18-25页
  2.1 千兆位以太网接口协议IEEE802.3 介绍第18页
  2.2 媒介访问控制器第18页
  2.3 直接内存存取第18-23页
    2.3.1 DMA优点分析第19-21页
    2.3.2 DMA工作原理第21-23页
  2.4 千兆媒体独立接口第23页
  2.5 卸载第23-24页
    2.5.1 LSO介绍第23-24页
    2.5.2 TSO介绍第24页
  2.6 本章小结第24-25页
第三章 IP总体架构设计第25-34页
  3.1 总体结构第25-26页
  3.2 媒介访问控制器第26-28页
  3.3 包处理器第28-31页
  3.4 DMA引擎第31-33页
    3.4.1 DMA功能设计第31-32页
    3.4.2 DMA架构设计第32-33页
  3.5 AXI4.0 控制器第33页
  3.6 本章小结第33-34页
第四章 主要模块详细设计第34-63页
  4.1 媒介访问控制器详细设计第34-41页
    4.1.1 功能介绍及架构图第34-35页
    4.1.2 接口信号列表及时序图第35-40页
    4.1.3 发送状态机设计第40-41页
    4.1.4 接收状态机设计第41页
  4.2 包处理器详细设计第41-54页
    4.2.1 功能介绍及架构图第42-44页
    4.2.2 接口信号列表及时序图第44-48页
    4.2.3 发送端数据处理第48-51页
    4.2.4 接收端数据处理第51-54页
  4.3 DMA引擎详细设计第54-60页
    4.3.1 功能介绍及架构图第54-55页
    4.3.2 接口信号列表及时序图第55-58页
    4.3.3 DMA接收引擎关键技术第58-59页
    4.3.4 DMA发送引擎关键技术第59-60页
  4.4 AXI控制器详细设计第60-62页
  4.5 本章小结第62-63页
第五章 测试平台、测试规范及测试结果第63-75页
  5.1 UVM验证平台简介第63-64页
  5.2 本IP的验证平台架构第64-65页
  5.3 以太网VIP第65-66页
  5.4 本设计的仿真验证第66-74页
    5.4.1 GMAC验证第67-69页
    5.4.2 包处理器验证第69-71页
    5.4.3 DMA引擎验证第71-73页
    5.4.4 AXI验证第73-74页
  5.5 本章小结第74-75页
第六章 总结及未来展望第75-77页
  6.1 总结第75-76页
  6.2 课题进一步研究方向及未来展望第76-77页
参考文献第77-79页
致谢第79-80页
攻读硕士学位期间已发表或录用的论文第80-82页

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